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《VerilogHDL數(shù)字系統(tǒng)設(shè)計(jì)及其應(yīng)用》

發(fā)布時(shí)間：2010-7-13 14:24    發(fā)布者：techieboy
關(guān)鍵詞： HDL , verilog , 數(shù)字系統(tǒng)
VerilogHDL數(shù)字系統(tǒng)設(shè)計(jì)及其應(yīng)用
袁俊泉等 編著，西安電子科技大學(xué)出版社

VerilogHDL數(shù)字系統(tǒng)設(shè)計(jì)及其應(yīng)用.rar (7.01 MB)
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youyou_zh 發(fā)表于 2010-9-8 21:12:29
henhao
darrenlocust1 發(fā)表于 2010-11-12 11:23:10
thanks
yading_1 發(fā)表于 2011-1-20 14:17:05
好好
leeux 發(fā)表于 2011-4-1 07:32:02
謝謝，看看
ligangm 發(fā)表于 2011-4-3 16:16:14
看看
thmoasmary 發(fā)表于 2011-5-11 12:25:32
學(xué)習(xí)下verilog了
iamfzm 發(fā)表于 2011-5-27 21:34:33
正在找Verilog呢，謝謝
cacc 發(fā)表于 2011-7-25 16:41:26
謝謝分享！
zhujizhen 發(fā)表于 2012-3-12 16:14:22
看看，學(xué)習(xí)一下
xzhu0130 發(fā)表于 2012-9-19 16:20:45
謝謝你
yuhuikeji 發(fā)表于 2014-12-10 14:07:34
看看，學(xué)習(xí)一下
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