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采樣保持放大器AD9100接口的測(cè)試板電路

發(fā)布時(shí)間:2011-4-18 10:54    發(fā)布者:circuit_share




如圖所示為AD9100接口的測(cè)試板電路。信號(hào)VIN輸入AD9100的4腳,保持電容和開關(guān)內(nèi)置在器件內(nèi),信號(hào)經(jīng)過(guò)采樣保持放大后由9腳直接輸出,也可以經(jīng)過(guò)AD9620緩沖級(jí)后輸出。時(shí)鐘輸人“CLOCK IN”加到模擬器件公司的超快比較器AD96685的同相輸入端,Q、Q非輸出后送到AD9100的CLK和CLK非(19、18腳),作為采樣保持控制信號(hào)。C1~Cl0采用0.01μF電容器,C13、Cl4采用鉭電容器。連接W1時(shí)為TTL時(shí)鐘信號(hào),連接W2時(shí)為地參考信號(hào)。
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