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[提問] verilog中寄存器大小

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樓主
發(fā)表于 2017-11-17 09:32:42 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
關鍵詞： reg
請問verilog中定義reg寄存器類型，有最大位寬限制嗎？
沙發(fā)
發(fā)表于 2018-10-11 14:53:02 | 只看該作者
寬度是自己定義的，沒有限制
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