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FPGA/CPLD文章列表

Xilinx Kintex-7 FPGA開發(fā)板支持接口32位 DDR4 SDRAM

隨著全球首個(gè)28nmFPGA的推出,賽靈思為設(shè)計(jì)人員提供了最廣泛的可編程平臺(tái),包括新型器件的多功能性。Xilinx Kintex™-7 FPGA的價(jià)格性能翻了一番,功耗和成本降低了一半,是當(dāng)今無線通信等 ...
2020年05月19日 14:51   |  
32位 DDR4 SDRAM   Kintex-7   Xilinx FPGA  

支持Xilinx FPGA中的32位 DDR4 SDRAM

盡管現(xiàn)代FPGA包含內(nèi)部存儲(chǔ)器,但可用存儲(chǔ)器的數(shù)量始終比專用存儲(chǔ)器芯片的存儲(chǔ)器數(shù)量級(jí)低幾個(gè)數(shù)量級(jí)。因此許多FPGA設(shè)計(jì)人員在其FPGA上附加某種類型的存儲(chǔ)器也就不足為奇了。由于其高速和低成本, ...
2020年05月18日 15:27   |  
32位   DDR4   SDRAM   Xilinx   FPGA  
貿(mào)澤備貨Microchip Hello FPGA套件,簡(jiǎn)化AI與圖像處理應(yīng)用的FPGA開發(fā)工作

貿(mào)澤備貨Microchip Hello FPGA套件,簡(jiǎn)化AI與圖像處理應(yīng)用的FPGA開發(fā)工作

貿(mào)澤電子 (Mouser Electronics) 即日起開始備貨Microchip Technology的Hello FPGA套件。此套件是一個(gè)入門級(jí)平臺(tái),專為在現(xiàn)場(chǎng)可編程門陣列 (FPGA) 領(lǐng)域經(jīng)驗(yàn)不足的終端用戶而開發(fā)。Hello FPGA套件 ...
2020年05月07日 14:28   |  
FPGA   SmartFusion  
片上網(wǎng)絡(luò)(NoC)技術(shù)的發(fā)展及其給高端FPGA帶來的優(yōu)勢(shì)

片上網(wǎng)絡(luò)(NoC)技術(shù)的發(fā)展及其給高端FPGA帶來的優(yōu)勢(shì)

Speedster 7t FPGA上的二維片上網(wǎng)絡(luò)(2D NoC)支持高帶寬數(shù)據(jù)加速應(yīng)用 作者:黃侖,Achronix資深現(xiàn)場(chǎng)應(yīng)用工程師 1. 概述 在摩爾定律的推動(dòng)下,集成電路工藝取得了高速發(fā)展,單位面積上 ...
2020年05月07日 11:32   |  
NoC   片上網(wǎng)絡(luò)   FPGA   Speedster  
實(shí)測(cè)!AlexNet卷積核在FPGA占90%資源仍跑750MHz|算力達(dá)288萬張圖像/秒

實(shí)測(cè)!AlexNet卷積核在FPGA占90%資源仍跑750MHz|算力達(dá)288萬張圖像/秒

Achronix創(chuàng)新的機(jī)器學(xué)習(xí)處理器(MLP)突破傳統(tǒng)FPGA時(shí)序性能瓶頸 作者:楊宇,Achronix資深現(xiàn)場(chǎng)應(yīng)用工程師 MLP_Conv2D是功能齊全的設(shè)計(jì),可將2D輸入圖像與多個(gè)內(nèi)核同時(shí)進(jìn)行卷積。 該設(shè)計(jì)充 ...
2020年04月27日 11:37   |  
機(jī)器學(xué)習(xí)   AlexNet   Achronix   MLP  

MR25HxxxDF的2.0mm裸露底墊新封裝已獲Everspin批準(zhǔn)生產(chǎn)

everspin在此生產(chǎn)基于180nm,130nm和90nm工藝技術(shù)節(jié)點(diǎn)的MRAM產(chǎn)品。產(chǎn)品包裝和測(cè)試業(yè)務(wù)遍及中國(guó),臺(tái)灣和其他亞洲國(guó)家。在平面內(nèi)和垂直磁隧道結(jié)(MTJ)STT-MRAM位單元的開發(fā)方面處于市場(chǎng)領(lǐng)先地位 ...
2020年04月14日 14:23   |  
MR25HxxxDF   Everspin   MRAM存儲(chǔ)器芯片   MRAM封裝尺寸  

新型MRAM技術(shù)量產(chǎn)實(shí)現(xiàn)低功耗

在新型 RAM 技術(shù)中,MRAM 對(duì)物聯(lián)網(wǎng)和邊緣計(jì)算設(shè)備具有特別有吸引力。因?yàn)樗軐?shí)現(xiàn)比目前這類硬件上的首選存儲(chǔ)類內(nèi)存 -NAND閃存-低得多的功耗,同時(shí)實(shí)現(xiàn)非易失性數(shù)據(jù)存儲(chǔ)。非易失性MRAM 本身訪問 ...
2020年04月07日 15:06   |  
MRAM   新型MRAM   RAM   新型MRAM技術(shù)  

非易失性MRAM誕生過程

MRAM技術(shù)是以可沉積在標(biāo)準(zhǔn)邏輯制程上的磁性隧道結(jié) (MTJ)儲(chǔ)存單元為基礎(chǔ),MTJ中包含了一個(gè)維持單一極性方向的固定層,和一個(gè)通過隧道結(jié)與其隔離的自由層。當(dāng)自由層被施予和固定層相同方向的極化 ...
2020年04月03日 14:36   |  
非易失性MRAM   MRAM   嵌入式MRAM   新存儲(chǔ)器  

eMRAM究竟是融合還是替代?

eMRAM屬于新型存儲(chǔ)技術(shù),同目前占據(jù)市場(chǎng)主流的NAND閃存相比較,其具有更快的存取速度和更高的耐用性,在邊緣設(shè)備中具有替代NAND閃存和部分SRAM芯片的潛質(zhì)。它在22nm的工藝下投產(chǎn),將會(huì)加快新型 ...
2020年04月01日 13:48   |  
eMRAM   MRAM   STT-MRAM   EVERSPIN  

如何學(xué)習(xí)FPGA技術(shù)

如何來學(xué)習(xí)FPGA技術(shù)? 面對(duì)網(wǎng)上錯(cuò)綜復(fù)雜的資料我們?cè)撛趺礃觼韺W(xué)習(xí)? (1)掌握FPGA設(shè)計(jì)的流程: 了解了FPGA的結(jié)構(gòu)和設(shè)計(jì)流程才有可能知道怎么去優(yōu)化設(shè)計(jì),提高速度,減少資源,不要急躁,不要 ...
2020年03月24日 15:33   |  
FPGA  

FPGA的主要應(yīng)用場(chǎng)景

通常認(rèn)為,SOPC是FPGA設(shè)計(jì)中的雞肋,“棄之可惜,食之無味”。誠然,SOPC一直不是FPGA的主流應(yīng)用設(shè)計(jì),制約主要因素則是性能,因?yàn)樽鳛樘幚砥魇褂脮r(shí),處理器主頻是其應(yīng)用范圍的瓶頸(SOPC的軟核 ...
2020年03月24日 15:15   |  
FPGA的主要應(yīng)用場(chǎng)景  

FPGA編程技術(shù)

2020年03月24日 15:12   |  
FPGA編程技術(shù)  

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