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FPGA/CPLD文章列表

FPGA單芯片四核二乘二取二的安全系統(tǒng)

摘要 基于嵌入式系統(tǒng)理論和容錯(cuò)系統(tǒng)體系結(jié)構(gòu),結(jié)合故障—安全電路的設(shè)計(jì)理念,提出了一種單芯片多軟核系統(tǒng)的設(shè)計(jì)方法,并給出基于FPGA的二乘二取二安全系統(tǒng)的設(shè)計(jì)方案,詳細(xì)介紹通過(guò)Actel Fusi ...
2010年03月11日 15:33   |  
FPGA   安全系統(tǒng)   單芯片  

FPGA的時(shí)鐘頻率同步設(shè)計(jì)

引言    網(wǎng)絡(luò)化運(yùn)動(dòng)控制是未來(lái)運(yùn)動(dòng)控制的發(fā)展趨勢(shì),隨著高速加工技術(shù)的發(fā)展,對(duì)網(wǎng)絡(luò)節(jié)點(diǎn)間的時(shí)間同步精度提出了更高的要求。如造紙機(jī)械,運(yùn)行速度為1 500~1 800 m/min,同步運(yùn)行的電機(jī)之間1 ...
2010年03月11日 15:23   |  
FPGA   頻率   設(shè)計(jì)   時(shí)鐘  
異步FIFO結(jié)構(gòu)及FPGA設(shè)計(jì)

異步FIFO結(jié)構(gòu)及FPGA設(shè)計(jì)

1 異步FIFO介紹 在現(xiàn)代的集成電路芯片中,隨著設(shè)計(jì)規(guī)模的不斷擴(kuò)大,一個(gè)系統(tǒng)中往往含有數(shù)個(gè)時(shí)鐘。多時(shí)鐘域帶來(lái)的一個(gè)問(wèn)題就是,如何設(shè)計(jì)異步時(shí)鐘之間的接口電路。異步FIFO(First In First O ...
2010年03月09日 23:28   |  
FIFO   FPGA  

3-DES算法的FPGA高速實(shí)現(xiàn)

引 言 從技術(shù)角度講,網(wǎng)絡(luò)安全除了依賴(lài)安全的網(wǎng)絡(luò)通信協(xié)議及應(yīng)用協(xié)議外,更多地取決于網(wǎng)絡(luò)設(shè)備如交換機(jī)、路由器等所提供的加/解密功能。目前,基于DES算法的加/解密硬件仍在廣泛應(yīng)用于國(guó)內(nèi)衛(wèi) ...
2010年03月09日 23:15   |  
FPGA   算法  

基于FPGA的星地信道模擬系統(tǒng)的研究與設(shè)計(jì)

1 引言 衛(wèi)星移動(dòng)通信系統(tǒng)所能提供的業(yè)務(wù)的可行性與質(zhì)量在很大程度上受到衛(wèi)星與移動(dòng)終端間信道特性的影響。研究這些影響,就需要在一定傳播特性下進(jìn)行實(shí)驗(yàn)。由于條件所限,不可能進(jìn)行實(shí)時(shí)現(xiàn)場(chǎng) ...
2010年03月05日 14:42   |  
FPGA   模擬系統(tǒng)   設(shè)計(jì)   信道   研究  

用單片機(jī)實(shí)現(xiàn)SRAM工藝FPGA的加密應(yīng)用

在現(xiàn)代電子系統(tǒng)設(shè)計(jì)中,由于可編程邏輯器件的卓越性能、靈活方便的可升級(jí)特性,而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用 SRAM工藝,要求每次上電,對(duì)FPGA器件進(jìn)行重配置,這 ...
2010年02月27日 12:29   |  
FPGA   SRAM   單片機(jī)   工藝   應(yīng)用  

用FPGA實(shí)現(xiàn)音頻采樣率的轉(zhuǎn)換

如今,即使低成本FPGA也能提供遠(yuǎn)遠(yuǎn)大于DSP的計(jì)算能力。目前的FPGA包含專(zhuān)用乘法器甚至DSP乘法/累加(MAC)模塊,能以550MHz以上的時(shí)鐘速度處理信號(hào)。 不過(guò),直到現(xiàn)在,音頻信號(hào)處理中還很少需要 ...
2010年02月07日 17:30   |  
FPGA   采樣   音頻  

FPGA的高速多通道數(shù)據(jù)采集控制器IP核設(shè)計(jì)

隨著可編程邏輯器件的不斷進(jìn)步和發(fā)展,F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來(lái)越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測(cè)系統(tǒng)中信號(hào)采集模塊控制器的 IP核,是采用硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)的。首先它是以ADS8364 ...
2010年01月25日 11:48   |  
FPGA   控制器   設(shè)計(jì)   數(shù)據(jù)采集   通道  

FPGA異步FIFO設(shè)計(jì)中的問(wèn)題與解決辦法

隨著數(shù)字電子系統(tǒng)設(shè)計(jì)規(guī)模的擴(kuò)大,一些實(shí)際應(yīng)用系統(tǒng)中往往含有多個(gè)時(shí)鐘,數(shù)據(jù)不可避免地要在不同的時(shí)鐘域之間傳遞。如何在異步時(shí)鐘之間傳輸數(shù)據(jù),是數(shù)據(jù)傳輸中一個(gè)至關(guān)重要的問(wèn)題,而采用FIFO正 ...
2010年01月16日 15:47   |  
FIFO   FPGA   辦法   設(shè)計(jì)   異步  

可重構(gòu)系統(tǒng)功耗相關(guān)的硬件任務(wù)調(diào)度算法

引 言 可重構(gòu)系統(tǒng)是指以軟件改變硬件結(jié)構(gòu)以實(shí)現(xiàn)具體應(yīng)用的計(jì)算平臺(tái),一般由非柔性但可編程的處理器和柔性的以程序控制重構(gòu)的數(shù)字邏輯器件構(gòu)成。目前國(guó)內(nèi)外的可重構(gòu)系統(tǒng)研究中,采用的可重構(gòu) ...
2010年01月11日 15:15   |  
功耗   任務(wù)   算法   系統(tǒng)   硬件  

做完一個(gè)FPGA項(xiàng)目后的感言

做了5年的FPGA了。手中經(jīng)歷的項(xiàng)目也不在少數(shù)。就在此刻又一個(gè)FPGA項(xiàng)目宣告結(jié)題,好多感受趁著現(xiàn)在還新鮮著,寫(xiě)出來(lái)和大家一起分享。不對(duì)之處,希望得到大家的指正。另外1234并沒(méi)有絕對(duì)順序,都 ...
2010年01月08日 11:19   |  
FPGA   感言   項(xiàng)目  

Virtex-5推動(dòng)超寬帶通信和測(cè)距的發(fā)展

自2002年美國(guó)聯(lián)邦通信委員會(huì)授權(quán)可以無(wú)執(zhí)照使用超寬帶(UWB) 無(wú)線電技術(shù)以來(lái),大多數(shù)采用該技術(shù)的商業(yè)應(yīng)用(如無(wú)線USB),都是基于用于高數(shù)據(jù)速率傳輸?shù)念l域調(diào)制技術(shù)(如OFDM)。UWB這種成熟的技術(shù)還 ...
2010年01月06日 12:38   |  
測(cè)距   發(fā)展   寬帶   通信  

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